Descrição
VSD - Embedded-UVM: Verificação e Emulação de Código Aberto
Avaliação: 3.9 de 516 avaliações
Total de 4 horas
29 palestras
Nível intermediário
Verificação e Emulação de Código Aberto
Claro, há uma demanda por verificação de código aberto, mas esse não é o único objetivo que buscamos atender. Existem várias tendências e desafios de verificação que o System Verilog e outras plataformas de verificação não conseguem atender. Portanto, apresentamos o Embedded-UVM para atender a essas necessidades. Nos últimos anos, o processo de verificação se tornou mais desafiador devido ao declínio da Lei de Moore. A frequência do processador estabilizou em 4GHz e está diminuindo à medida que fazemos a transição para processadores multi-core. Consequentemente, executar simulações em chips maiores tem se tornado cada vez mais difícil, uma vez que o tamanho do chip continua a crescer enquanto a velocidade do processador permanece estagnada. A velocidade da simulação é limitada a menos que adotemos processadores multi-core. As ferramentas EDA contemporâneas executam simulações RTL em um ambiente multi-core, ao contrário do System Verilog. Como resultado, o test-bench é executado em uma thread enquanto o RTL é executado em várias threads. O RTL é mais formal e pode ser sintetizado e particionado, permitindo que diferentes partições sejam executadas em diferentes processadores. Por outro lado, o test-bench é comportamental e não pode ser particionado como o RTL.Sobre o Palestrante: Puneet Sharma
Puneet Sharma é formado em Eletrônica pelo Punjab Engineering College em 1994. Com 24 anos de experiência na indústria de VLSI, Puneet trabalhou para STMicro, Motorola, Texas Instruments e TranSwitch. Nos últimos 8 anos, ele tem trabalhado na Coverity Systems Technology, onde fornece serviços de verificação e desenvolve soluções de código aberto viáveis para verificação de chips. Puneet é o principal desenvolvedor do Embedded UVM.O que você aprenderá
- Obtenha um profundo entendimento do Embedded UVM e suas aplicações como plataforma para Verificação Funcional e Emulação baseada em SoC FPGA. - Aprenda a codificar um testbench alimentado por Embedded UVM para um design de acelerador de hardware IP. - Adapte o testbench para plataformas baseadas em Cyclone V e Ultrascale Zynq para demonstrar soluções de emulação de baixo custo baseadas em SoCFPGA alimentadas por Embedded UVM.Estimar frete
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