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Curso de VSD - Verificação Funcional Usando Embedded-UVM - Parte 1

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Preço:
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Descrição

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VSD - Verificação Funcional Usando Embedded-UVM - Parte 1

Introdução à Tecnologia de Simulação de Eventos Discretos, Verificação Funcional, Conhecendo as ferramentas de simulação

Aqui está um curso, "Fundamentos de Verificação de VLSI", feito sob medida para qualquer pessoa que queira mudar do back-end para o front-end OU para pessoas curiosas que queiram saber e aprender o que exatamente acontece no campo da verificação de VLSI. A razão pela qual é "feito sob medida" é porque começa desde o básico e nas próximas partes deste curso, as coisas gradualmente avançarão para o nível avançado de UVM. Outra razão para este curso ser "feito sob medida" é devido à ferramenta de código aberto usada para cobrir os laboratórios introduzidos neste curso. Esta é a Parte - 1 da "Série de Verificação". Esta parte abordará o fluxo de design SoC, noções básicas de verificação funcional, tendências e desafios, introdução ao Embedded-UVM de código aberto, emulação e o DUT. Sobre o Embedded-UVM: O Embedded UVM é uma implementação de código aberto do padrão IEEE 1800.2 da Metodologia Universal de Verificação. Neste webinar, mergulhamos no Embedded UVM e em seus casos de uso como plataforma para Verificação Funcional e Emulação baseada em SoC-FPGA. Sobre o Palestrante: John Smith é formado em Eletrônica pelo Punjab Engineering College em 1994. Ele possui 24 anos de experiência na indústria de VLSI, onde trabalhou para ABCMicro, XYZMotor, PQR Instruments e MNOTran. Nos últimos 8 anos, ele tem trabalhado para a Coverify Systems Technology, onde fornece serviços de verificação e trabalha na criação de soluções de código aberto viáveis para verificação de chips. John é o principal desenvolvedor do Embedded UVM.

O que você aprenderá

- Fluxo de design SoC, papel da Verificação Funcional - Modelagem Lógica, Introdução ao Verilog - Conceito de Hierarquia, Simulação em Tempo, e Concorrência na Modelagem de Hardware - Tecnologia de Simulação, Simulação de Eventos Discretos - Tendências e Desafios de Verificação - Conceitos e Princípios de Verificação Funcional - Arquitetura e Componentes de Testbench - Laboratório - Configuração e Uso da Ferramenta - um DUT simples com testbench Verilog tradicional será fornecido com um Makefile para compilar e simular - Depuração usando formas de onda"

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